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[讨论] load flow 时候 Unresolved control conditions detected 是什么解决呢

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发表于 2013-7-4 00:32:41 | 显示全部楼层 |阅读模式

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各位同学好,以下请问几个问题/ [, X9 H6 t6 ^% @% e
1 请问 当我做VSC HVDC的 load flow时候,做 load flow 之后,没有报错,也都是绿色现实,但是显示为,- J8 w6 d/ x$ d% E
! n& y. g- B% J" u/ E
Unresolved control conditions detected. Further outer loop iterations required
: j$ B% n1 u0 j5 J" f1 t$ g
3 P; W0 D' v7 @8 B9 V2 [' f- g7 \; M# n* _. y
请问各位知道这个应该怎么改么?
/ g, b' t6 v" R& i2 D- C3 ^: J1 M5 S3 l( b* ^4 `
5 H3 u% v! ^' M, D
2 load flow 中 ,如果 active power flow 方向为由左到右(见箭头)% C; P9 t* t# v+ l7 ?

active power flow

active power flow

+ X5 ?9 G! s, v4 }4 k- [( ~但是左边的busbar 显示为+350, 右边的bus 显示为-350, 那么power 方向到底是怎么样?
6 j7 M3 B. F/ r# H
* I8 z3 |) y$ |$ o% S2 @% y& o# X2 s; A+ [0 n7 Y$ x
3 DigSilent 3 W! M8 k7 s- D5 R
Integration Step Size 如何设置 ?在initial calculation 的时候 + o" K: _1 p# v5 i$ a& M$ k
& g3 l0 [* u3 x( c+ H  X

3 O* H1 O+ P3 t
$ t1 s, [- G, h+ w0 |. y, P. [7 H

# v: y7 ?. \8 y. i' q6 [非常感谢大家的时间和回复!!!. v5 ?$ ?8 r# K% l" F$ R" I$ _
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# o- z# D; G; Y/ Z0 D6 C' {

3 b; K4 ~1 J8 |% G# p# t
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    DIgSILENT里面好多东西感觉怪怪的
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