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这个西瓜不太甜 发表于 2019-2-24 17:41:07

强烈支持楼主ing……

Bourne01 发表于 2019-2-25 08:09:42

强烈支持楼主ing……

这个西瓜不太甜 发表于 2019-2-25 20:23:26

强烈支持楼主ing……

Bourne01 发表于 2019-2-26 08:43:11

强烈支持楼主ing……

这个西瓜不太甜 发表于 2019-3-4 22:24:40

强烈支持楼主ing……

这个西瓜不太甜 发表于 2019-3-4 22:24:55

强烈支持楼主ing……

这个西瓜不太甜 发表于 2019-3-4 22:25:21

强烈支持楼主ing……

SilverBullet 发表于 2019-3-9 19:05:24

istone 发表于 2011-5-26 19:40
做得很不错，我最近在学这个。请问，PLL出来的相位为什么要减去1.57呢，我看到很多例子都这么处理，能告诉 ...

看不到PSCAD锁相环的内部电路，但是你去监测Ud和Uq就会发现，不减去0.5Pi，是Ud=0，Uq>0；减去0.5Pi，是Ud>0，Uq=0。根据你参考系的选择不同，来选择减不减0.5Pi

Inversun 发表于 2019-3-9 19:40:38

强烈支持楼主ing……::biggrin::::biggrin::::biggrin::

whery 发表于 2019-5-12 21:17:04

看到这帖子真是高兴！

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